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인기글

학부공부

7. ARM 5stage pipeline report 1 [Computer Architecture] 7.1. Module description Goal : Detailed explanation for each module of the processor we implemented [Provided circuit diagram analysis and modification] [Most important point to consider] 1. Each stage has 1 clock cycle time. (In other words, the MODULE_armreduced output pc update and pipeline registers use the same edge.) Therefore, the 15th block of reg[31:0] registers[15:0] of MODULE_Register.. 2021.12.02
17. IPC(2) 안녕하세요. 오늘은 저번 시간에 이어 IPC에 대해 알아보는 마지막 시간입니다. 저번 포스팅에서는 IPC Model과 각 model별 구체적 메커니즘 : 테크닉에 대해 알아보았었습니다. 특히 Signal에 대해 많은 부분 할애하여 설명드렸었죠. 컴퓨터 네트워크 과목, 컴퓨터 구조 과목과도 매우 밀접한 관련이 있는 topic이였습니다. 2021.11.21 - [학부공부/OS_운영체제] - 15. IPC(1) 15. IPC(1) 안녕하세요. 오늘은 IPC에 대해 알아보겠습니다. 저번 포스팅을 끝으로 프로세스에 대해 알아보았었는데요. 프로그램과 프로세스, 문맥전환, 프로세스 상태, linux에서의 프로세스 생성에 대해 설 ku320121.tistory.com 이번 포스팅에서는 각 메커니즘 별 구체적인 예제들을.. 2021.11.24
2. Open-ended quiz Checking criteria: (1) application of the course materials discussed after midterm, (2) concreteness, (3) originality, (4) [no] jumps in the protocol procedure, (5) possibility of performance calculation of the designed scheme, (6) meeting the design requirements Q. Suppose a communication channel induces the following type of errors. Once an error occurs at a bit position, the next bit will als.. 2021.12.24
TP1.9. Python Part Executable File Excessive Execution Time Problem [OS Scheduling simulator] Python Part Executable File Excessive Execution Time Problem I think the problem is caused by excessive module import. The first thing I thought of when this issue occurred was the time to plot boxes over time in animation creation. To solve this issue, we have devised the following three solutions. In fact, not all solutions were applied, but only some were adopted and reflected in the code. Se.. 2022.06.06

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